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楼主: cfuer

[解码器] 声卡数字输出到DAC的过程中,时基信息如何传输?

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发表于 2009-4-8 16:49:49 | 显示全部楼层
原帖由 shanyechungu 于 2009-4-8 16:33 发表
呵呵,白版,你是想让我提出一个符合你上述描述的情况的解决方案么?

很简单,数码线拔掉,DAC会认为是出现错误,出现错误应马上停止一切活动

否则可能造成不可修复之后过。

这个在硬件设计中再常见不过了。 ...

我来试着补充另一种可能。注意,我说的是可能。

DAC中没有自身的晶振,其振荡信号由由输入的数据信号中提取。
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发表于 2009-4-8 16:50:48 | 显示全部楼层
原帖由 小白 于 2009-4-8 16:46 发表

另一个解释是,S/PDIF传输的数码信号,大家知道是一个复合信号,包含了数字信号和时钟讯息两部分. 这两个部分讯息是按照BMC编码合并在一起的. 到DAC之后,首先数字接收器就会把两者分开,也就是说数字信号归数字信号,时钟讯息被抽出来. 数字信号送入缓存,OK,没问题,但我们应牢记DAC做的每件事都是依据clock的. 没有clock则没有任何活动,没有任何结果. 没有clock的单纯的数字信号,没任何意义.


这个clock信号,不是DAC的clock信号,请不要将二者混淆。


DAC有自己的定时器来定时转换。所以你说的那个clock,只是对解析传输数据其作用,一旦数据进入memery,则其作用消失,剩下的,完全受控于DA。
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发表于 2009-4-8 16:54:40 | 显示全部楼层
原帖由 shanyechungu 于 2009-4-8 16:50 发表


这个clock信号,不是DAC的clock信号,请不要将二者混淆。


DAC有自己的定时器来定时转换。所以你说的那个clock,只是对解析传输数据其作用,一旦数据进入memery,则其作用消失,剩下的,完全受控于DA。

你能确定一般DAC都自含晶振或在分体中都搭配独立的晶振?
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发表于 2009-4-8 16:57:38 | 显示全部楼层
原帖由 shanyechungu 于 2009-4-8 16:50 发表


这个clock信号,不是DAC的clock信号,请不要将二者混淆。


DAC有自己的定时器来定时转换。所以你说的那个clock,只是对解析传输数据其作用,一旦数据进入memery,则其作用消失,剩下的,完全受控于DA。





你对CD系统的理解完全错误.  看来你的理解还是电脑模式下的. 我也早猜到了,你是一个对电脑很熟悉,但对CD机工作模式不熟悉的人,才会有那些说法和假设.

在CD系统中,数码信号到达DAC后,数字接收芯片会在S/PDIF信号里分离出incoming signal的clock,然后送入PLL(锁相环)电路. PLL起的作用大致是把这个clock处理得更为稳定. PLL之后是数字滤波和DA芯片. 可以说S/PDIF信号里的那个clock是解码器工作的基础,依据,而绝对不是"作用消失"! 当然,设计良好的PLL可以提高这个clock的精度,使之jitter降低.  

你的认识是,S/PDIF过来的clock是没用的,到了DAC后作用消失,然后DA时唯一起作用的是DA部分的clock. 这个认识是不对的. 你可以再找些CD机工作原理和模式的文章看看.
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发表于 2009-4-8 17:00:12 | 显示全部楼层

回复 256# 的帖子

所以不论DAC的缓存有多大,在数码线被拔掉的一刹那,clock信号消失了,这样DAC便不能做任何事,即使缓存里存了再多的数据,也毫无用处. 这就是"CD系统是一个实时流动的系统"的含义. CD系统是每分每秒地,实时地按照clock信号在流动的. 不能把它看成仅仅是数据的流动,而是数据+clock的共同流动. 脱离了clock信号的数据,没有任何意义和结果.


呵呵,白版,你这段表述还是有问题。如下:

你觉得DA转换始终就是传输数据中的clock信号。完全错误。根本不可行。
DA有自己的时钟系统,其中断时间设定为初始化交互时转盘发送的采样率(如44.1kHz)

此时,定时器周期为(1/44.1k)S,定时器到时,产生中断,触发DA进行一次转换,再计时,再转换,两次转换之间的时间间隔就是(1/44.1k)S。与传输数据中的clock无关。

试问,你传一个wav到mp3播放器上面,然后在播放时,时钟信号是如何实时发送给mp3播放器的?

你真的认为,DA的转换触发信号是由传输数据流里面的clock生成的?

这么不可靠的方法,你能提出来,不知道CD工程师肯不肯采用。

[ 本帖最后由 shanyechungu 于 2009-4-8 17:07 编辑 ]
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发表于 2009-4-8 17:06:40 | 显示全部楼层

回复 260# 的帖子

可以说S/PDIF信号里的那个clock是解码器工作的基础,依据,而绝对不是"作用消失"! 当然,设计良好的PLL可以提高这个clock的精度,使之jitter降低.  


你这样含糊其词的表达,我不能完全明白。

你真的觉得DA是用那个传输过来的数据中的clock来 定时 的?
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发表于 2009-4-8 17:15:16 | 显示全部楼层
原帖由 shanyechungu 于 2009-4-8 17:06 发表


你这样含糊其词的表达,我不能完全明白。

你真的觉得DA是用那个传输过来的数据中的clock来 定时 的?




再说仔细些,是这样的,PLL有自己的参考时钟(一般是晶振),但它输出的时钟信号既不完全是incoming clock,也不完全是自己的参考时钟,而是"依据参考时钟优化过的incoming clock".  PLL电路里都有一个Phase Detector,起的作用是检测进入clock的相位和参考时钟的相位,使之同步. 打个比方就是你家里有一参考钟,你以它为参考,来把外来时钟调得更准,更平稳.

其实你想想,假如incoming clock是没用的,又何必想出一个S/PDIF协议来传输它? 到了DAC后为何又要把它分离出来? 如果按你的设想,DA完全按照DAC自己的参考时钟工作,那输入信号根本不必有clock (那整个系统就成了电脑了).
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发表于 2009-4-8 17:17:00 | 显示全部楼层
原帖由 ljw100 于 2009-4-8 16:49 发表

DAC中没有自身的晶振,其振荡信号由由输入的数据信号中提取。


没有晶振,怎样进行初始化通讯?
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发表于 2009-4-8 17:25:24 | 显示全部楼层
其实我前面费了那么多笔墨描述的"CD模式" (相对于"电脑工作模式"),其核心在于什么呢? 就在于保持各个环节的同步,保持各个环节都按照同一个clock来运行. 所以数据是伴随着clock运行的,脱离clock谈数据是没有意义也没有结果的.  

而shanyechungu及其他一些人的理解,则是完全不同的. 你们的理解是,数据可以是独立的,不伴随clock的(S/PDIF里包含的clock信息你认为没用); 只要到了DA这个环节,DA有一个高度精确的参考时钟,依据这个来解码就一切OK,no problem了.
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发表于 2009-4-8 17:44:19 | 显示全部楼层
谁说文件的copy就没有jitter了?只要数字信号动起来 就有jitter
就算是硬盘里存储的数据 尽管静态的时候0就是0 1就是1 但是动起来的时候原来传过来的jitter特征还是会被磁记录点保留着
PC hi-fi : IBM x220i->TC K8->Apogee Rosetta200 (Mutec iclock Syn Both) ->Drawmer MC2.1->ADAM S4X-H
CD system : CEC TL3N-> Apogee Rosetta200(Mutec iclock Syn Both)->Drawmer MC2.1->ADAM S4X-H

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发表于 2009-4-8 17:49:18 | 显示全部楼层
对电脑声卡的工作流程我不了解,请问一下电脑声卡的工作流程是怎么样的. 当给电脑发出一条指令,要求播放一个WAV文件时,我的理解是硬盘磁头找到这个文件,然后把它读入一个缓存. WAV文件本身不带clock信息,这个读的过程应该也是无关clock的. 然则在之后的流程中,哪个环节开始有clock了呢? 声卡内部的DA芯片是依据什么时钟来解码的呢? 应该就是自带的晶振产生的参考时钟吧?
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发表于 2009-4-8 17:49:36 | 显示全部楼层
好的,白版,之前我对CD模式的理解,却如你所说。

DAC确实是从S/PDIF协议中取出clock信号的,但是我在该规范中没有找到对该信号进行描述的相关内容。

该clock信号的频率是多少,其何种作用,我不清楚。现在不好多说。


但,DA有其自身时钟证据如附件一。

你所说的incoming clock 和 DA时钟共同作用的结果我没能理解。



另,在此系统中PLL的主要作用应是倍频。PLL的震荡输出来源于其自身的振荡电路。
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发表于 2009-4-8 17:52:38 | 显示全部楼层
原帖由 shanyechungu 于 2009-4-8 17:49 发表
好的,白版,之前我对CD模式的理解,却如你所说。

DAC确实是从S/PDIF协议中取出clock信号的,但是我在该规范中没有找到对该信号进行描述的相关内容。

该clock信号的频率是多少,其何种作用,我不清楚。现在不好 ...


最怕就是理论掌握不全就开始做推断
反正大家都在学习 我一哥们是搞DSP开发的(主攻音频) 有空问他后再来说说
PC hi-fi : IBM x220i->TC K8->Apogee Rosetta200 (Mutec iclock Syn Both) ->Drawmer MC2.1->ADAM S4X-H
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发表于 2009-4-8 17:55:57 | 显示全部楼层
回268楼: 最常见的数字接收芯片都是11.2896MHz的,这个频率是CD取样频率44100Hz的256倍,也就是说,它们使用的是256倍的超取样(oversampling).  yamaha芯片是384倍超取样的.
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发表于 2009-4-8 18:09:29 | 显示全部楼层
原帖由 小白 于 2009-4-8 17:55 发表
回268楼: 最常见的数字接收芯片都是11.2896MHz的,这个频率是CD取样频率44100Hz的256倍,也就是说,它们使用的是256倍的超取样(oversampling).  yamaha芯片是384倍超取样的.


no,白版,超取样不是这样定义的。

超取样是DSP技术,不是在DA阶段实现的。超取样技术是指DAC前插入数字滤波器进行以取样频率4、8倍等的超取样,寄生频率便被转到更高频率,就能采用衰减特性较平缓的低通滤波器,从而大大改善失真。

11.2896MHz只是一个晶振频率,用来定时的。

不过这个又扯远了,不谈。就谈那个clock的问题。
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